Back to home page

LXR

 
 

    


File indexing completed on 2025-05-11 08:23:40

0001 /*  Blackfin External Peripheral Interface Registers
0002  *
0003  *  Copyright (c) 2008 Kallisti Labs, Los Gatos, CA, USA
0004  *             written by Allan Hessenflow <allanh@kallisti.com>
0005  *
0006  *  The license and distribution terms for this file may be
0007  *  found in the file LICENSE in this distribution or at
0008  *  http://www.rtems.org/license/LICENSE.
0009  */
0010 
0011 #ifndef _ebiuRegs_h_
0012 #define _ebiuRegs_h_
0013 
0014 /* register addresses */
0015 
0016 #define EBIU_AMGCTL             (EBIU_BASE_ADDRESS + 0x0000)
0017 #define EBIU_AMBCTL0            (EBIU_BASE_ADDRESS + 0x0004)
0018 #define EBIU_AMBCTL1            (EBIU_BASE_ADDRESS + 0x0008)
0019 #define EBIU_SDGCTL             (EBIU_BASE_ADDRESS + 0x0010)
0020 #define EBIU_SDBCTL             (EBIU_BASE_ADDRESS + 0x0014)
0021 #define EBIU_SDRRC              (EBIU_BASE_ADDRESS + 0x0018)
0022 #define EBIU_SDSTAT             (EBIU_BASE_ADDRESS + 0x001c)
0023 
0024 /* register fields */
0025 
0026 #define EBIU_AMGCTL_CDPRIO                            0x0100
0027 #define EBIU_AMGCTL_AMBEN_MASK                        0x000e
0028 #define EBIU_AMGCTL_AMBEN_SHIFT                            1
0029 #define EBIU_AMGCTL_AMCKEN                            0x0001
0030 
0031 #define EBIU_AMBCTL0_B1WAT_MASK                   0xf0000000
0032 #define EBIU_AMBCTL0_B1WAT_SHIFT                          28
0033 #define EBIU_AMBCTL0_B1RAT_MASK                   0x0f000000
0034 #define EBIU_AMBCTL0_B1RAT_SHIFT                          24
0035 #define EBIU_AMBCTL0_B1HT_MASK                    0x00c00000
0036 #define EBIU_AMBCTL0_B1HT_SHIFT                           22
0037 #define EBIU_AMBCTL0_B1ST_MASK                    0x00300000
0038 #define EBIU_AMBCTL0_B1ST_SHIFT                           20
0039 #define EBIU_AMBCTL0_B1TT_MASK                    0x000c0000
0040 #define EBIU_AMBCTL0_B1TT_SHIFT                           18
0041 #define EBIU_AMBCTL0_B1RDYPOL                     0x00020000
0042 #define EBIU_AMBCTL0_B1RDYEN                      0x00010000
0043 #define EBIU_AMBCTL0_B0WAT_MASK                   0x0000f000
0044 #define EBIU_AMBCTL0_B0WAT_SHIFT                          12
0045 #define EBIU_AMBCTL0_B0RAT_MASK                   0x00000f00
0046 #define EBIU_AMBCTL0_B0RAT_SHIFT                           8
0047 #define EBIU_AMBCTL0_B0HT_MASK                    0x000000c0
0048 #define EBIU_AMBCTL0_B0HT_SHIFT                            6
0049 #define EBIU_AMBCTL0_B0ST_MASK                    0x00000030
0050 #define EBIU_AMBCTL0_B0ST_SHIFT                            4
0051 #define EBIU_AMBCTL0_B0TT_MASK                    0x0000000c
0052 #define EBIU_AMBCTL0_B0TT_SHIFT                            2
0053 #define EBIU_AMBCTL0_B0RDYPOL                     0x00000002
0054 #define EBIU_AMBCTL0_B0RDYEN                      0x00000001
0055 
0056 #define EBIU_AMBCTL1_B3WAT_MASK                   0xf0000000
0057 #define EBIU_AMBCTL1_B3WAT_SHIFT                          28
0058 #define EBIU_AMBCTL1_B3RAT_MASK                   0x0f000000
0059 #define EBIU_AMBCTL1_B3RAT_SHIFT                          24
0060 #define EBIU_AMBCTL1_B3HT_MASK                    0x00c00000
0061 #define EBIU_AMBCTL1_B3HT_SHIFT                           22
0062 #define EBIU_AMBCTL1_B3ST_MASK                    0x00300000
0063 #define EBIU_AMBCTL1_B3ST_SHIFT                           20
0064 #define EBIU_AMBCTL1_B3TT_MASK                    0x000c0000
0065 #define EBIU_AMBCTL1_B3TT_SHIFT                           18
0066 #define EBIU_AMBCTL1_B3RDYPOL                     0x00020000
0067 #define EBIU_AMBCTL1_B3RDYEN                      0x00010000
0068 #define EBIU_AMBCTL1_B2WAT_MASK                   0x0000f000
0069 #define EBIU_AMBCTL1_B2WAT_SHIFT                          12
0070 #define EBIU_AMBCTL1_B2RAT_MASK                   0x00000f00
0071 #define EBIU_AMBCTL1_B2RAT_SHIFT                           8
0072 #define EBIU_AMBCTL1_B2HT_MASK                    0x000000c0
0073 #define EBIU_AMBCTL1_B2HT_SHIFT                            6
0074 #define EBIU_AMBCTL1_B2ST_MASK                    0x00000030
0075 #define EBIU_AMBCTL1_B2ST_SHIFT                            4
0076 #define EBIU_AMBCTL1_B2TT_MASK                    0x0000000c
0077 #define EBIU_AMBCTL1_B2TT_SHIFT                            2
0078 #define EBIU_AMBCTL1_B2RDYPOL                     0x00000002
0079 #define EBIU_AMBCTL1_B2RDYEN                      0x00000001
0080 
0081 #define EBIU_SDGCTL_CDDBG                         0x40000000
0082 #define EBIU_SDGCTL_TCSR                          0x20000000
0083 #define EBIU_SDGCTL_EMREN                         0x10000000
0084 #define EBIU_SDGCTL_FBBRW                         0x04000000
0085 #define EBIU_SDGCTL_EBUFE                         0x02000000
0086 #define EBIU_SDGCTL_SRFS                          0x01000000
0087 #define EBIU_SDGCTL_PSSE                          0x00800000
0088 #define EBIU_SDGCTL_PSM                           0x00400000
0089 #define EBIU_SDGCTL_PUPSD                         0x00200000
0090 #define EBIU_SDGCTL_TWR_MASK                      0x00180000
0091 #define EBIU_SDGCTL_TWR_SHIFT                             19
0092 #define EBIU_SDGCTL_TRCD_MASK                     0x00038000
0093 #define EBIU_SDGCTL_TRCD_SHIFT                            15
0094 #define EBIU_SDGCTL_TRP_MASK                      0x00003800
0095 #define EBIU_SDGCTL_TRP_SHIFT                             11
0096 #define EBIU_SDGCTL_TRAS_MASK                     0x000003c0
0097 #define EBIU_SDGCTL_TRAS_SHIFT                             6
0098 #define EBIU_SDGCTL_PASR_MASK                     0x00000030
0099 #define EBIU_SDGCTL_PASR_ALL                      0x00000000
0100 #define EBIU_SDGCTL_PASR_0_1                      0x00000010
0101 #define EBIU_SDGCTL_PASR_0                        0x00000020
0102 #define EBIU_SDGCTL_CL_MASK                       0x0000000c
0103 #define EBIU_SDGCTL_CL_SHIFT                               2
0104 #define EBIU_SDGCTL_SCTLE                         0x00000001
0105 
0106 #define EBIU_SDBCTL_EBCAW_MASK                        0x0030
0107 #define EBIU_SDBCTL_SHIFT                                  4
0108 #define EBIU_SDBCTL_EBCAW_8                           0x0000
0109 #define EBIU_SDBCTL_EBCAW_9                           0x0010
0110 #define EBIU_SDBCTL_EBCAW_10                          0x0020
0111 #define EBIU_SDBCTL_EBCAW_11                          0x0030
0112 #define EBIU_SDBCTL_EBSZ_MASK                         0x000e
0113 #define EBIU_SDBCTL_EBSZ_SHIFT                             1
0114 #define EBIU_SDBCTL_EBSZ_16M                          0x0000
0115 #define EBIU_SDBCTL_EBSZ_32M                          0x0002
0116 #define EBIU_SDBCTL_EBSZ_64M                          0x0004
0117 #define EBIU_SDBCTL_EBSZ_128M                         0x0006
0118 #define EBIU_SDBCTL_EBSZ_256M                         0x0008
0119 #define EBIU_SDBCTL_EBSZ_512M                         0x000a
0120 #define EBIU_SDBCTL_EBE                               0x0001
0121 
0122 #define EBIU_SDRRC_RDIV_MASK                          0x0fff
0123 #define EBIU_SDRRC_RDIV_SHIFT                              0
0124 
0125 #define EBIU_SDSTAT_BGSTAT                            0x0020
0126 #define EBIU_SDSTAT_SDEASE                            0x0010
0127 #define EBIU_SDSTAT_SDRS                              0x0008
0128 #define EBIU_SDSTAT_SDPUA                             0x0004
0129 #define EBIU_SDSTAT_SDSRA                             0x0002
0130 #define EBIU_SDSTAT_SDCI                              0x0001
0131 
0132 
0133 #endif /* _ebiuRegs_h_ */